工程地震仪中数据集中器的研究与实现
【学位单位】:重庆大学
【学位级别】:硕士
【学位年份】:2016
【中图分类】:P631.43
【部分图文】:
重庆大学硕士学位论文电路设计路设计据需求分析可以看出,在设定采样频率为数据量已经达到 56.25Mbit,所以必须采数据存储量、数据吞吐率、系统最高时存选用 Hynix公司生产的 HY57V56820 12 根地址线,行地址线(A0—A12)和 4 个 bank,所以单片 SDRAM 存储提供了参考时钟的上升沿完全同步操作沿同步。其数据路径内部流水线达到非VTTL 兼容[20]。该系列芯片工作频率可足数据存储要求。
M_CLK O 时钟M_CKE O 时钟使能信号M_CS_N O 片选信号_DQ[7:0] I/O 数据M_WE_N O 命令M_DQM O 数据掩码电路设计中的数据传输至数据集中器,需要制定相应的成熟的数据传输有 RS232 以及 RS485 两种。最大为 15 m,最高速率为 20 KB/s,且仅支平衡发送和差分接收,最大通信距离约为 1本文采用 RS485 来实现数据传输,设定波特器部分的 RS485 电路原理图。
重庆大学硕士学位论文逻辑电路设计字检波器的核心逻辑器件采用 Altera 公司的 EP3C10E144C8。FPGA 是整体系统的主控单元,它管理着整个系统的运行。ADS1271 芯片模数率、SDRAM芯片HY57V56820的读写操作以及串口通信的执行,均由F控制。GA 作为主控单元,需要与多个模块进行通信。依据 EP3C10E144C8 技课题硬件需求,设计了如图 3.5 所示的 FPGA 电路原理图,实现对 A、RS485/上位机通信等模块的集中控制。
【参考文献】
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本文编号:2821088
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